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Só pode mudar o sinal APENAS quando o sinal do clock transitar de 0 para 1 |
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Controlam o estado de um FF, mas o FF não responde até um clock transitar de 0 para 1. |
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Só é alterada nos estantes de “subida” do clock. |
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A alteração de um FF pode ser dada, também, pela forma de um CLK negado. |
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É um circuito formado basicamente de ANDs. |
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É quando o sinal opera mantendo as entradas ativas durante todo o período do pulso. |
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É quando o sinal opera mantendo as entradas ativas apenas no instante da mudança de estado do sinal de clock. |
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Anormalidade na tabela verdade: |
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Se S e R forem iguais a 1 quando o clock for habilitado, nenhum comportamento particular é garantido. |
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É um pulso alto que dura de 2 a 5 nanosegundos e é originado pelo atraso de CLK'. |
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Pulso estreito e positivo produzido pelo atraso do inversor de CLK'. |
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Luiz Henrique Moreira Dias(86892) & Marcos Eduardo Lopes Honorato(86379) |
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